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Una opinión sobre el G5 | 44 comentarios (42 temáticos, 2 editoriales, 0 ocultos)

Segmentos por todas partes... Y páginas (3.00 / 1) (#37)
por jorginius ("jorginius" en Google Mail) a las Fri Jul 11th, 2003 at 01:56:13 AM CET
(Información Usuario) http://www.rodriguezmoreno.com

(i486 Microprocessor Programmer's Reference Manual, Intel Corporation, 1990, Parágrafo 2.1.2)

Dirección lógica (0-64TB) -> dirección efectiva (0-4BG) -> dirección física (0-2^L) Donde L es el número de líneas del bus de direcciones.

No veo claro si me estás dando la razón o si no soy capaz de ver lo que quieres decir.

Lo que has leído en el manual es cierto. El espacio de direccionamiento virtual es de 64 TB, la dirección efectiva (u offset) es de 20 bits (20 y no 32) que, hablando en páginas, nos da esos 4GB por segmentos y la dirección física en un 486 es de 32 bits, lo que nos permite acceder a 4 GB de memoria física.

Todo correcto... Pero lo que parece que das a entender es que esto último (la dirección física de 32 bits) limita el uso del resto del espacio virtual de alguna forma :-?. Simplemente cuando accedamos a alguna dirección que no esté disponible en memoria principal, el bit de presencia del descriptor estará inactivo (o el bit de una de las páginas del segmento, ya que estamos trabajando con segmentación paginada), saltaría un trap y el SO que trabajase con ese esquema haría lo que tuviera que hacer.

El espacio de 64 TB es un espacio teórico que nadie usará nunca por ineficiente. Implica usar la 16K entradas conjuntas de las tablas de descriptores de segmento, que a 64 bits por descriptor hacen un total de 128 MB: 64 MB por proceso, sólo la LDT. Sin contar con las tablas de páginas, el tamaño y la complejidad de las estructuras que tendría que manejar el kernel para representar un solo proceso o para llevar la contabilidad de la memoria, los algoritmos que manejen aquello, etc.

... Pero que duda cabe de que sobre el papel y con la publicidad en la mano es perfectamente realizable :-).

Por otra parte, sobre los 64 GB:

The processor maps this 64 terabyte logical address space onto the physical address space (up to 4 gigabytes) by the address translation mechanism describred in Chapter 5.

Si cotejas el capítulo 5 de tu manual con el capítulo correspondiente de uno de un Pentium II (p.ej) verás que es diferente. Hay un nivel más de indirección: paginación a 3 niveles (o a 2 pero con páginas de 2 MB) y la dirección física resultante es de 36 bits.

Y qué opinas de los procesadores VLIW (Very Large Instruction Word)? ¿Tienen futuro?

No sabría decirte, es la primera noticia que tengo de ellos :-}. La verdad es que así, en frío y como lo explicas, no veo la ventaja al invento. Se impone una entrada de diario explicando a los legos como yo de qué va el asunto :-).

[ Padre ]

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